时钟电路;时钟发生器;锁相环

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用PE3240数字锁相环设计的L波段频率源

锁相环(PLL)频率合成技术是频率源设计的一种现代化技术，已广泛应用于通信、导航、电子侦查、电子对抗、遥控遥测及现代化仪器仪表等领域中。 1 集成锁相环芯片PE...

锁相环 PLL PE3240 2007-11-11

微型高稳定锁相时钟频率源

引言由锁相环构成的间接式频率合成器在无线通信领域发挥着非常重要的作用。通常采用锁相频率合成器的输出信号来作为无线接收机中的本振信号，以使直接频率调制器、频率解...

锁相环时钟频率源合成器 2007-09-21

赛普拉斯推出完全可配置型时钟发生器

赛普拉斯半导体公司为其独特的InstaClock?时序解决方案系列新添了一款可配置、可编程时钟发生器。新推出的CY22801时钟进一步增强了赛普拉斯InstaC...

赛普拉斯时钟发生器 CY22801 2007-09-10

TI推出最灵活的3.3V、2.5V与1.8V时钟发生器系列

日前，德州仪器 (TI) 宣布推出一系列高度可编程的 1:4 锁相环 (PLL) 时钟发生器，该系列产品能够以统一的输入频率生成多达九个输出时钟源，每个输出都能...

时钟发生器 1:4 PLL VCXO 2007-07-18

电子式多功能电能表的设计与实现

本文阐述了电子式多功能电能表的设计方法、硬件设计的技术关键和软件设计流程。并以nec的μpd78f0338单片机为例，实现了一款具有四种费率、六条负荷曲线和两套...

多功能电能表电能计量时钟电路 2007-04-25

电脑主机板上时钟电路设计(图)

所有的数字电路都需要依靠时钟信号来使组件的运作同步，每单位时间内电路可运作的次数取决于时钟的频率，因此时钟运作的频率即被大家视为系统运作的性能指针。主机板时...

时钟电路时钟发生器锁相环 2007-04-25

如何调试锁相环频率合成器

无线电系统会因为各种各样的原因而采用基于锁相环（pll）技术的频率合成器。pll的好处包括：（1）易于集成到ic中。（2）无线信道间隔中的灵活性。（3）可获得高...

频率合成器锁相环压控振荡器 2007-04-24

锁相环电路设计和调试心得

1．锁相环的设计的起因：这个电路设计的初衷就是为了我项目中的DDS电路提供可选的时钟...

锁相环 2007-04-12

基于FM1702N的低功耗射频IC卡读写器设计

本文介绍一款便携式巡更机（射频读写器）的设计。该读写器主要由mcu、射频ic卡读写模块、天线及usb通信接口等部分组成。为了方便对巡更情况的实时记录，系统采用了...

射频读写器时钟电路电感耦合 2007-04-11

锁相环电路设计和调试心得

1．锁相环的设计的起因：这个电路设计的初衷就是为了我项目中的DDS电路提供可选的时钟...

锁相环 2007-04-01

基于MPU/PLL和CPLD技术的数字正弦信号发生器的设计与分析

摘要:直接数字波形合成式正弦波发生器,对于提高多功能校验仪的稳定性和准确度具有基础性意义。研究了基于微处理器(micro processor unit , M...

直接数字合成正弦波发生器微控制器锁相环复杂可编程逻辑器件 2007-01-15

基于AD6620的中频数字直扩接收机本地载波的同步恢复

摘　要：直接序列扩频接收机对本地载波的同步要求非常严格，以往所需电路复杂。本文方法在数字域通过粗、细双环调整达到载波同步，具有同步时间短、精度高、灵活性强、所需...

直接序列扩频通信；接收机；软件无线电；数字下变频；锁相环 2006-10-26

无线局域网射频前端VCO及高速双模预分频器设计

摘　要：论述了一种应用于802.11a无线局域网射频前端高速频率合成器中两个关键模块的设计: 负阻LC压控振荡器(VCO)与高速双模分频器(DMP)的射频全芯片...

锁相环；压控振荡器；双模分频器 2006-10-22

高速信号、时钟及数据捕捉

随着模/数转换器的数据转换取样率提高至每秒千兆个取样 (GSPS) 以上的水平，数据转换系统必须作出相应的配合，才可支持这样高的转换率，而其他支持性的模拟元件也...

|时钟电路|数据捕捉|美国国家半导体公司| 2006-02-17

千兆以太网卡芯片时钟产生电路的设计与实现

摘要：本文介绍了千兆以太网卡芯片时钟产生电路的设计，包括体系结构设计、系统设计与仿真、电路设计与仿真，及版图设计。该时钟产...

|锁相环|电荷泵|压控振荡器| 2005-10-15

16位微处理器L80C186-10测试技术研究

摘要：L80C186-10是一款高度集成的16位微处理器，本文主要对L80C186-10内部各主要功能块的测试做了详细论述...

|时钟发生器|寄存器|中断向量| 2005-08-19

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